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Fast, Efficient And Predictable Memory Accesses: Optimization Algorithms for Memory Architecture Aware Compilation - Couverture rigide

 
9781402048210: Fast, Efficient And Predictable Memory Accesses: Optimization Algorithms for Memory Architecture Aware Compilation

Synopsis

Fast, Efficient and Predictable Memory Accesses presents techniques for designing fast, energy-efficient and timing predictable memory systems. By using a careful combination of compiler optimizations and architectural improvements, we can achieve more than what would be feasible at one of the levels in isolation. The described optimization algorithms achieve the goals of high performance and low energy consumption. In addition to these benefits, the use of scratchpad memories significantly improves the timing predictability of the entire system, leading to tighter worst case execution time bounds (WCET). The WCET is a relevant design parameter for all timing critical systems. In addition, the book covers algorithms to exploit the power down modes of main memories in SDRAM technology, as well as the execute-in-place feature of Flash memories. The final chapter considers the impact of the register file, which is also part of the memory hierarchy.

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À propos de l?auteur

Prof. Peter Marwedel is well established within the Electronic Design Automation community, he has co-authored four books with us and also published his best-selling Embedded Systems Design (text)book with Springer.

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  • ÉditeurSpringer-Verlag New York Inc.
  • Date d'édition2006
  • ISBN 10 1402048211
  • ISBN 13 9781402048210
  • ReliureRelié
  • Langueanglais
  • Nombre de pages258
  • Coordonnées du fabricantnon disponible

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9789048172009: Fast, Efficient and Predictable Memory Accesses: Optimization Algorithms for Memory Architecture Aware Compilation

Edition présentée

ISBN 10 :  9048172004 ISBN 13 :  9789048172009
Editeur : Springer, 2010
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Lars Wehmeyer, Peter Marwedel
Edité par SPRINGER NATURE, 2006
ISBN 10 : 1402048211 ISBN 13 : 9781402048210
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Lars Wehmeyer
Edité par Springer, 2006
ISBN 10 : 1402048211 ISBN 13 : 9781402048210
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Lars Wehmeyer
Edité par Springer, 2006
ISBN 10 : 1402048211 ISBN 13 : 9781402048210
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Edité par Springer, 2006
ISBN 10 : 1402048211 ISBN 13 : 9781402048210
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Edité par Springer, 2006
ISBN 10 : 1402048211 ISBN 13 : 9781402048210
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Wehmeyer, Lars; Marwedel, Peter
Edité par Springer, 2006
ISBN 10 : 1402048211 ISBN 13 : 9781402048210
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Vendeur : Ria Christie Collections, Uxbridge, Royaume-Uni

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Lars Wehmeyer|Peter Marwedel
Edité par Springer Netherlands, 2006
ISBN 10 : 1402048211 ISBN 13 : 9781402048210
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Vendeur : moluna, Greven, Allemagne

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Gebunden. Etat : New. Focus on the increasing importance of memory system design in embedded systemsSolutions to the problems of energy-inefficient and slow memory systems with unpredictable access timesDemonstration of the benefits of exploiting architectural f. N° de réf. du vendeur 458474969

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Lars Wehmeyer
ISBN 10 : 1402048211 ISBN 13 : 9781402048210
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Vendeur : THE SAINT BOOKSTORE, Southport, Royaume-Uni

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Hardback. Etat : New. This item is printed on demand. New copy - Usually dispatched within 5-9 working days 589. N° de réf. du vendeur C9781402048210

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Wehmeyer, Lars; Marwedel, Peter
Edité par Springer, 2006
ISBN 10 : 1402048211 ISBN 13 : 9781402048210
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Vendeur : Lucky's Textbooks, Dallas, TX, Etats-Unis

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Lars Wehmeyer
Edité par Springer Jul 2006, 2006
ISBN 10 : 1402048211 ISBN 13 : 9781402048210
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Vendeur : AHA-BUCH GmbH, Einbeck, Allemagne

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Buch. Etat : Neu. Neuware - Fast, Efficient and Predictable Memory Accesses presents techniques for designing fast, energy-efficient and timing predictable memory systems. By using a careful combination of compiler optimizations and architectural improvements, we can achieve more than what would be feasible at one of the levels in isolation. The described optimization algorithms achieve the goals of high performance and low energy consumption. In addition to these benefits, the use of scratchpad memories significantly improves the timing predictability of the entire system, leading to tighter worst case execution time bounds (WCET). The WCET is a relevant design parameter for all timing critical systems. In addition, the book covers algorithms to exploit the power down modes of main memories in SDRAM technology, as well as the execute-in-place feature of Flash memories. The final chapter considers the impact of the register file, which is also part of the memory hierarchy. N° de réf. du vendeur 9781402048210

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