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Synopsis
In diesem System wird eine neue Klasse von hybriden AHt-MPSoC-Architekturen vorgestellt, in denen Hardware-Beschleuniger zwischen Prozessoren geteilt werden, um die Systemkosten zu senken und die Leistung zu erhöhen. Ein neuartiges hybrides Speicherschema wird vorgeschlagen. Dieses Schema wird durch umfangreiche Simulationen bewertet und zeigt signifikante Leistungsverbesserungen. Die hybride asymmetrische heterogene MPSoC-Architektur besteht aus einem statischen Speicher mit wahlfreiem Zugriff (SRAM) und einer eingebetteten Zelle mit dynamischem Speicher mit wahlfreiem Zugriff (eDRAM) in Verbindung mit der gemeinsamen Methodik des Hardware-Beschleunigers (HWA), um die gemeinsamen Berechnungsaufgaben zwischen den gleichzeitigen Aufgaben der Anwendung zu bestimmen. Ein experimentelles Ergebnis zeigt, dass das vorgeschlagene hybride AHt-MPSoC-System den Stromverbrauch im Vergleich zum bestehenden System reduziert und seine Flächen/Leistungs-Kompromisse sehr schnell bewertet.
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Gemeinsamer Hardware-Beschleuniger für hybride AHt-MPSoC-Architektur
Edité par
Verlag Unser Wissen Apr 2022, 2022
ISBN 10 : 6204664808
ISBN 13 : 9786204664804
Neuf
Taschenbuch
Vendeur : BuchWeltWeit Ludwig Meier e.K., Bergisch Gladbach, Allemagne
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Taschenbuch. Etat : Neu. This item is printed on demand - it takes 3-4 days longer - Neuware -In diesem System wird eine neue Klasse von hybriden AHt-MPSoC-Architekturen vorgestellt, in denen Hardware-Beschleuniger zwischen Prozessoren geteilt werden, um die Systemkosten zu senken und die Leistung zu erhöhen. Ein neuartiges hybrides Speicherschema wird vorgeschlagen. Dieses Schema wird durch umfangreiche Simulationen bewertet und zeigt signifikante Leistungsverbesserungen. Die hybride asymmetrische heterogene MPSoC-Architektur besteht aus einem statischen Speicher mit wahlfreiem Zugriff (SRAM) und einer eingebetteten Zelle mit dynamischem Speicher mit wahlfreiem Zugriff (eDRAM) in Verbindung mit der gemeinsamen Methodik des Hardware-Beschleunigers (HWA), um die gemeinsamen Berechnungsaufgaben zwischen den gleichzeitigen Aufgaben der Anwendung zu bestimmen. Ein experimentelles Ergebnis zeigt, dass das vorgeschlagene hybride AHt-MPSoC-System den Stromverbrauch im Vergleich zum bestehenden System reduziert und seine Flächen/Leistungs-Kompromisse sehr schnell bewertet. 68 pp. Deutsch. N° de réf. du vendeur 9786204664804
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Gemeinsamer Hardware-Beschleuniger für hybride AHt-MPSoC-Architektur
Edité par
Verlag Unser Wissen, 2022
ISBN 10 : 6204664808
ISBN 13 : 9786204664804
Neuf
Couverture souple
Vendeur : moluna, Greven, Allemagne
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Etat : New. Dieser Artikel ist ein Print on Demand Artikel und wird nach Ihrer Bestellung fuer Sie gedruckt. Autor/Autorin: Prasath R. ArunDr. R. Arun Prasath, Professor in der Abteilung fuer ECE am Siddhartha Institute of Technology & Science, Telangana. Er erhielt seinen Doktortitel in ICE von der Anna University, Chennai. Er verfuegt ueber mehr als 10 Jah. N° de réf. du vendeur 585927907
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Gemeinsamer Hardware-Beschleuniger für hybride AHt-MPSoC-Architektur
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Verlag Unser Wissen Apr 2022, 2022
ISBN 10 : 6204664808
ISBN 13 : 9786204664804
Neuf
Taschenbuch
Vendeur : buchversandmimpf2000, Emtmannsberg, BAYE, Allemagne
Évaluation du vendeur 5 sur 5 étoiles
Taschenbuch. Etat : Neu. Neuware -In diesem System wird eine neue Klasse von hybriden AHt-MPSoC-Architekturen vorgestellt, in denen Hardware-Beschleuniger zwischen Prozessoren geteilt werden, um die Systemkosten zu senken und die Leistung zu erhöhen. Ein neuartiges hybrides Speicherschema wird vorgeschlagen. Dieses Schema wird durch umfangreiche Simulationen bewertet und zeigt signifikante Leistungsverbesserungen. Die hybride asymmetrische heterogene MPSoC-Architektur besteht aus einem statischen Speicher mit wahlfreiem Zugriff (SRAM) und einer eingebetteten Zelle mit dynamischem Speicher mit wahlfreiem Zugriff (eDRAM) in Verbindung mit der gemeinsamen Methodik des Hardware-Beschleunigers (HWA), um die gemeinsamen Berechnungsaufgaben zwischen den gleichzeitigen Aufgaben der Anwendung zu bestimmen. Ein experimentelles Ergebnis zeigt, dass das vorgeschlagene hybride AHt-MPSoC-System den Stromverbrauch im Vergleich zum bestehenden System reduziert und seine Flächen/Leistungs-Kompromisse sehr schnell bewertet.Books on Demand GmbH, Überseering 33, 22297 Hamburg 68 pp. Deutsch. N° de réf. du vendeur 9786204664804
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Gemeinsamer Hardware-Beschleuniger für hybride AHt-MPSoC-Architektur
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Taschenbuch. Etat : Neu. nach der Bestellung gedruckt Neuware - Printed after ordering - In diesem System wird eine neue Klasse von hybriden AHt-MPSoC-Architekturen vorgestellt, in denen Hardware-Beschleuniger zwischen Prozessoren geteilt werden, um die Systemkosten zu senken und die Leistung zu erhöhen. Ein neuartiges hybrides Speicherschema wird vorgeschlagen. Dieses Schema wird durch umfangreiche Simulationen bewertet und zeigt signifikante Leistungsverbesserungen. Die hybride asymmetrische heterogene MPSoC-Architektur besteht aus einem statischen Speicher mit wahlfreiem Zugriff (SRAM) und einer eingebetteten Zelle mit dynamischem Speicher mit wahlfreiem Zugriff (eDRAM) in Verbindung mit der gemeinsamen Methodik des Hardware-Beschleunigers (HWA), um die gemeinsamen Berechnungsaufgaben zwischen den gleichzeitigen Aufgaben der Anwendung zu bestimmen. Ein experimentelles Ergebnis zeigt, dass das vorgeschlagene hybride AHt-MPSoC-System den Stromverbrauch im Vergleich zum bestehenden System reduziert und seine Flächen/Leistungs-Kompromisse sehr schnell bewertet. N° de réf. du vendeur 9786204664804
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