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Paperback. Etat : new. Paperback. Dieses Buch schlaegt den Entwurf und die Architektur eines dynamisch skalierbaren Dual-Core-Pipeline-Prozessors vor. Die Methodik des Entwurfs besteht in der Kernfusion zweier Prozessoren, wobei zwei unabhaengige Kerne dynamisch zu einer groesseren Verarbeitungseinheit umgewandelt werden koennen oder als separate Verarbeitungselemente verwendet werden koennen, um eine hohe sequentielle Leistung und eine hohe parallele Leistung zu erzielen. Der Prozessor bietet zwei Ausfuehrungsmodi. Modus 1 ist der Multiprogrammierungsmodus fuer die Ausfuehrung von Befehlsstroemen mit geringerer Datenbreite, d. h. jeder Kern kann einzeln 16-Bit-Operationen ausfuehren. In diesem Modus wird die Leistung durch die parallele Ausfuehrung von Befehlen in beiden Kernen auf Kosten der Flaeche verbessert. In Modus 2 sind beide Prozessorkerne gekoppelt und verhalten sich wie eine einzige Verarbeitungseinheit mit hoher Datenbreite, d. h. sie koennen 32-Bit-Operationen ausfuehren. Um diesen Modus zu realisieren, ist eine zusaetzliche Kommunikation zwischen den Kernen erforderlich. Der Modus kann dynamisch umgeschaltet werden, sodass dieser Prozessor mit einem einzigen Design mehrere Funktionen bieten kann. Das Design und die Verifizierung des Prozessors wurden erfolgreich mit Verilog auf der Xilinx 14.1-Plattform durchgefuehrt. Der Prozessor wurde sowohl in der Simulation als auch in der Synthese mit Hilfe von Testprogrammen verifiziert. This item is printed on demand. Shipping may be from multiple locations in the US or from the UK, depending on stock availability. N° de réf. du vendeur 9786209220456
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Paperback. Etat : new. Paperback. Dieses Buch schlaegt den Entwurf und die Architektur eines dynamisch skalierbaren Dual-Core-Pipeline-Prozessors vor. Die Methodik des Entwurfs besteht in der Kernfusion zweier Prozessoren, wobei zwei unabhaengige Kerne dynamisch zu einer groesseren Verarbeitungseinheit umgewandelt werden koennen oder als separate Verarbeitungselemente verwendet werden koennen, um eine hohe sequentielle Leistung und eine hohe parallele Leistung zu erzielen. Der Prozessor bietet zwei Ausfuehrungsmodi. Modus 1 ist der Multiprogrammierungsmodus fuer die Ausfuehrung von Befehlsstroemen mit geringerer Datenbreite, d. h. jeder Kern kann einzeln 16-Bit-Operationen ausfuehren. In diesem Modus wird die Leistung durch die parallele Ausfuehrung von Befehlen in beiden Kernen auf Kosten der Flaeche verbessert. In Modus 2 sind beide Prozessorkerne gekoppelt und verhalten sich wie eine einzige Verarbeitungseinheit mit hoher Datenbreite, d. h. sie koennen 32-Bit-Operationen ausfuehren. Um diesen Modus zu realisieren, ist eine zusaetzliche Kommunikation zwischen den Kernen erforderlich. Der Modus kann dynamisch umgeschaltet werden, sodass dieser Prozessor mit einem einzigen Design mehrere Funktionen bieten kann. Das Design und die Verifizierung des Prozessors wurden erfolgreich mit Verilog auf der Xilinx 14.1-Plattform durchgefuehrt. Der Prozessor wurde sowohl in der Simulation als auch in der Synthese mit Hilfe von Testprogrammen verifiziert. This item is printed on demand. Shipping may be from our Sydney, NSW warehouse or from our UK or US warehouse, depending on stock availability. N° de réf. du vendeur 9786209220456
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Paperback. Etat : new. Paperback. Dieses Buch schlaegt den Entwurf und die Architektur eines dynamisch skalierbaren Dual-Core-Pipeline-Prozessors vor. Die Methodik des Entwurfs besteht in der Kernfusion zweier Prozessoren, wobei zwei unabhaengige Kerne dynamisch zu einer groesseren Verarbeitungseinheit umgewandelt werden koennen oder als separate Verarbeitungselemente verwendet werden koennen, um eine hohe sequentielle Leistung und eine hohe parallele Leistung zu erzielen. Der Prozessor bietet zwei Ausfuehrungsmodi. Modus 1 ist der Multiprogrammierungsmodus fuer die Ausfuehrung von Befehlsstroemen mit geringerer Datenbreite, d. h. jeder Kern kann einzeln 16-Bit-Operationen ausfuehren. In diesem Modus wird die Leistung durch die parallele Ausfuehrung von Befehlen in beiden Kernen auf Kosten der Flaeche verbessert. In Modus 2 sind beide Prozessorkerne gekoppelt und verhalten sich wie eine einzige Verarbeitungseinheit mit hoher Datenbreite, d. h. sie koennen 32-Bit-Operationen ausfuehren. Um diesen Modus zu realisieren, ist eine zusaetzliche Kommunikation zwischen den Kernen erforderlich. Der Modus kann dynamisch umgeschaltet werden, sodass dieser Prozessor mit einem einzigen Design mehrere Funktionen bieten kann. Das Design und die Verifizierung des Prozessors wurden erfolgreich mit Verilog auf der Xilinx 14.1-Plattform durchgefuehrt. Der Prozessor wurde sowohl in der Simulation als auch in der Synthese mit Hilfe von Testprogrammen verifiziert. This item is printed on demand. Shipping may be from our UK warehouse or from our Australian or US warehouses, depending on stock availability. N° de réf. du vendeur 9786209220456
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