Formal Semantics and Proof Techniques for Optimizing VHDL Models

Langue : anglais

Edité par Springer, 2012

146137331X / 9781461373315

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Druck auf Anfrage Neuware - Printed after ordering - Formal Semantics and Proof Techniques for Optimizing VHDL Models presents a formal model of VHDL that clearly specifies both the static and dynamic semantics of VHDL. It provides a mathematical framework for representing VHDL constructs and shows how those constructs can be formally manipulated to reason about VHDL. The dynamic semantics is presented as a description of what the simulation of VHDL means. In particular it specifies what values the signals of a VHDL description will take if the description were to be executed. An advantage of the approach is that the semantic model can be used to validate different simulation algorithms. The book also presents an embedding of the dynamic semantics in a proof checker which is then used to prove equivalences of classes of VHDL descriptions. Formal Semantics and Proof Techniques for Optimizing VHDL Models is written for hardware designers who are interested in the formal semantics of VHDL.…

N° de réf. du vendeur 9781461373315

Titre
Formal Semantics and Proof Techniques for Optimizing VHDL Models
Auteur
Philip A. Wilsey
Éditeur
Springer
Année de publication
2012
État de l'article
Neu
Reliure
Taschenbuch
Langue
anglais
ISBN à 10 chiffres
146137331X
ISBN à 13 chiffres
9781461373315
Poids de l'article
289 grammes
Dimensions
235x155x11 mm

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