Hardware Accelerated Functional Verification

Langue : anglais

Edité par LAP LAMBERT Academic Publishing Dez 2011, 2011

384655913X / 9783846559130

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This item is printed on demand - it takes 3-4 days longer - Neuware -Functional verification is a widespread technique to check whether a hardware system satisfies a given correctness specification. As the complexity of modern hardware systems rises rapidly, it is a challenging task to find appropriate techniques for acceleration of this process. This thesis introduces a design of a verification framework that exploits the field-programmable gate array (FPGA) technology for cycle-accurate acceleration of simulation-based verification, while retaining the possibility to run verification also in the user-friendly debugging environment of a simulator. The presented framework is written in SystemVerilog and complies with the principles of functional verification methodologies (OVM, UVM) as well as assertion-based verification, making its application range quite large. According to the experiments carried out on a prototype implementation, the achieved acceleration is proportional to the number of checked transactions and the complexity of the verified system. The maximum acceleration achieved on the set of experiments was over 130 times. 60 pp. Englisch.…

N° de réf. du vendeur 9783846559130

Titre
Hardware Accelerated Functional Verification
Auteur
Marcela ¿Imková
Éditeur
LAP LAMBERT Academic Publishing Dez 2011
Année de publication
2011
État de l'article
Neu
Reliure
Taschenbuch
Langue
anglais
ISBN à 10 chiffres
384655913X
ISBN à 13 chiffres
9783846559130
Poids de l'article
107 grammes
Dimensions
220x150x4 mm

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