Low Power Asynchronous Logic design for Viterbi Decoders

Langue : anglais

Edité par LAP LAMBERT Academic Publishing Sep 2018, 2018

6139851297 / 9786139851294

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This item is printed on demand - Print on Demand Titel. Neuware -This book discusses the design of asynchronous logic and its importance in digital design. Most of the decoders designed and fabricated today are synchronous. The problem of clock skew is a major challenge in the synchronous design. Alternatively, asynchronous systems are becoming familiar as they are not in need of global clock, as these systems are locally synchronized by means of communication protocols. Asynchronous VLSI architecture for a Viterbi decoder is designed using Quasi Delay Insensitive (QDI) templates and Differential Cascode Voltage Switch Logic (DCVSL). It gives an overview of asynchronous implementation.VDM Verlag, Dudweiler Landstraße 99, 66123 Saarbrücken 56 pp. Englisch.

N° de réf. du vendeur 9786139851294

Titre
Low Power Asynchronous Logic design for Viterbi Decoders
Auteur
T. Kalavathi Devi Sakthivel
Éditeur
LAP LAMBERT Academic Publishing Sep 2018
Année de publication
2018
État de l'article
Neu
Reliure
Taschenbuch
Langue
anglais
ISBN à 10 chiffres
6139851297
ISBN à 13 chiffres
9786139851294
Poids de l'article
102 grammes
Dimensions
220x150x4 mm

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Emtmannsberg, BAYE, Allemagne

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