Morphological Image Processing: Architecture and VLSI design
Langue : anglais
Edité par Springer US, 1993
- Livre broché
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Zustand: Sehr gut | Seiten: 308 | Sprache: Englisch | Produktart: Bücher | Summary Based on the experiences of past designs and the outcome of recent studies in the comparisons of low-level image processing architectures, a pipelined system for real time low-image processing has been designed and realized in CMOS technology. To minimize design pitfalls, a study was performed to the details of the design solutions that have been found in embodimentsof the three main architectural groups of image processing; the Square Processor Arrays, the Linear Processor Arrays and the Pipelines. This is reflected in a theoretical model. As the design is based on bitplane-wise processing of images, research was performed on the principles ofCellularLogic Processing of two dimensional images. of binary A methodology has been developed that is based on the transformation images using sets of Hit-or-Miss masks. This method appeared to be extendable to higher dimensional images. A theoretical model for the generation of break-point conditions in high dimensional images has been developed, and applied up to dimension three.…
N° de réf. du vendeur 1225065/202
- Titre
- Morphological Image Processing: Architecture and VLSI design
- Auteur
- P. P. Jonker
- Éditeur
- Springer US
- Année de publication
- 1993
- État de l'article
- Sehr gut
- Reliure
- Couverture souple
- Langue
- anglais
- ISBN à 10 chiffres
- 9020127667
- ISBN à 13 chiffres
- 9789020127669
- Catalogues du vendeur
- Bücher
The field of image processing has spawned a number of special parallel computer architectures: the Square (Simd), Processor Array, the Pyramid, the Linear Processor Array (or scan line array) and the Processor Pipeline. This book features a classification of low-level image processing operations, reviews some intermediate level algorithms, and gives a short introduction into computer architecture used for image and digital signal processing. Morphology-based processing images is introduced by treating cellular logic operations such as skeletonization as hit-or-miss transformations. This approach can be extended to images of higher dimensions than two and a method is described to construct hit-or-miss masks for the skeletonization of these images.
In the second part of the book a study is performed on the speed bottlenecks that can be found in the main architectural groups followed by the description of a method for the structured design of integrated, digital hardware.
The Vlsi design of a Cmos Processing Element for the real-time processing of binary images and the board level design of a scalable processor pipeline for a real-time low-level processing of grey value images is described in detail.
Finally, a computer architecture for low and intermediate processing of two and three dimensional images if proposed.
« Synopsis » peut appartenir à une autre édition de cet ouvrage.
Présentation de l'éditeur
The field of image processing has spawned a number of special parallel computer architectures: the Square (Simd), Processor Array, the Pyramid, the Linear Processor Array (or scan line array) and the Processor Pipeline. This book features a classification of low-level image processing operations, reviews some intermediate level algorithms, and gives a short introduction into computer architecture used for image and digital signal processing. Morphology-based processing images is introduced by treating cellular logic operations such as skeletonization as hit-or-miss transformations. This approach can be extended to images of higher dimensions than two and a method is described to construct hit-or-miss masks for the skeletonization of these images.
In the second part of the book a study is performed on the speed bottlenecks that can be found in the main architectural groups followed by the description of a method for the structured design of integrated, digital hardware.
The Vlsi design of a Cmos Processing Element for the real-time processing of binary images and the board level design of a scalable processor pipeline for a real-time low-level processing of grey value images is described in detail.
Finally, a computer architecture for low and intermediate processing of two and three dimensional images if proposed.
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