High Speed Low Offset Power Efficient Dynamic CMOS Comparator

Langue : anglais

Edité par LAP LAMBERT Academic Publishing, 2019

6139474736 / 9786139474738

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nach der Bestellung gedruckt Neuware - Printed after ordering - This book describes various Trade-Offs in Comparator Design especially in Analog & Mixed Signal VLSI Design. The various comparator designs have been illustrated in details with detailed analysis. Further, the analysis and design of a high speed low offset power efficient dynamic CMOS Comparator based on Fully Differential and Double Tail structure is presented. A novel concept of Fully Differential Double Tail Dynamic comparator (FDDTDC) realized with high-speed, low offset with optimized power and area than that of the conventional dynamic comparators is proposed. The end result reveals the potential of new proposed comparator architecture and design methodology for high-speed low offset power efficient applications.

N° de réf. du vendeur 9786139474738

Détails bibliographiques

Titre
High Speed Low Offset Power Efficient Dynamic CMOS Comparator
Auteur
Niranjan Devashrayee
Éditeur
LAP LAMBERT Academic Publishing
Année de publication
2019
État de l'article
Neu
Reliure
Taschenbuch
Langue
anglais
ISBN à 10 chiffres
6139474736
ISBN à 13 chiffres
9786139474738
Poids de l'article
375 grammes
Dimensions
220x150x15 mm

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