Reconfiguration Dynamique des deux Niveaux Caches L1 et L2 : MPSoC A Architecture Homogène

Langue : français

Edité par Presses Académiques Francophones, 2015

3841634508 / 9783841634504

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nach der Bestellung gedruckt Neuware - Printed after ordering - La hiérarchie mémoire contribue largement à la consommation énergétique des MPSoC (Multi-Processors-System-On-Chip). Dans ce Livre, nous présentons une technique de réglage de deux niveaux de caches (nommés L1 et L2) basée sur une exploration intelligente des paramètres du cache : taille totale, taille de la ligne et l'associativité. L'objectif principal est d'y trouver les meilleures configurations (L1 & L2) associées à chaque intervalle de l'application embarquée. Nous validons notre approche en utilisant un ensemble de programmes de test de la famille des MiBench et Spec2006 sur des outils de simulation d'architectures de systèmes multi-cores.

N° de réf. du vendeur 9783841634504

Titre
Reconfiguration Dynamique des deux Niveaux Caches L1 et L2 : MPSoC A Architecture Homogène
Auteur
Asmaa Bengueddach
Éditeur
Presses Académiques Francophones
Année de publication
2015
État de l'article
Neu
Reliure
Taschenbuch
Langue
français
ISBN à 10 chiffres
3841634508
ISBN à 13 chiffres
9783841634504
Poids de l'article
191 grammes
Dimensions
220x150x8 mm

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Einbeck, Allemagne

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